.. | .. |
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11 | 11 | #define __ROCKCHIP_IEP2_REGS_H__ |
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12 | 12 | |
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13 | 13 | #define IEP2_REG_FRM_START 0x0000 |
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| 14 | +#define IEP2_REG_FRM_EN BIT(0) |
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14 | 15 | #define IEP2_REG_IEP_CONFIG0 0x0004 |
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15 | 16 | #define IEP2_REG_CCLK_SRESET_P BIT(22) |
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16 | 17 | #define IEP2_REG_ACLK_SRESET_P BIT(21) |
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.. | .. |
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37 | 38 | #define IEP2_REG_MD_CLK_ON BIT(1) |
---|
38 | 39 | #define IEP2_REG_CLK_ON BIT(0) |
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39 | 40 | #define IEP2_REG_STATUS 0x0014 |
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| 41 | +#define IEP2_REG_ARST_FINISH_DONE BIT(0) |
---|
40 | 42 | #define IEP2_REG_INT_EN 0x0020 |
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| 43 | +#define IEP2_REG_TIMEOUT_EN BIT(5) |
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41 | 44 | #define IEP2_REG_BUS_ERROR_EN BIT(4) |
---|
42 | 45 | #define IEP2_REG_OSD_MAX_EN BIT(1) |
---|
43 | 46 | #define IEP2_REG_FRM_DONE_EN BIT(0) |
---|
44 | 47 | #define IEP2_REG_INT_CLR 0x0024 |
---|
| 48 | +#define IEP2_REG_TIMEOUT_CLR BIT(5) |
---|
45 | 49 | #define IEP2_REG_BUS_ERROR_CLR BIT(4) |
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46 | 50 | #define IEP2_REG_OSD_MAX_CLR BIT(1) |
---|
47 | 51 | #define IEP2_REG_FRM_DONE_CLR BIT(0) |
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48 | 52 | #define IEP2_REG_INT_STS 0x0028 |
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| 53 | +#define IEP2_REG_RO_TIMEOUT_STS(x) ((x) & BIT(5)) |
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49 | 54 | #define IEP2_REG_RO_BUS_ERROR_STS(x) ((x) & BIT(4)) |
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50 | 55 | #define IEP2_REG_RO_OSD_MAX_STS(x) ((x) & BIT(1)) |
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51 | 56 | #define IEP2_REG_RO_FRM_DONE_STS(x) ((x) & BIT(0)) |
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.. | .. |
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73 | 78 | #define IEP2_REG_DIL_FIELD_ORDER(x) (((x) & 1) << 5) |
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74 | 79 | #define IEP2_REG_DIL_OUT_MODE(x) (((x) & 1) << 4) |
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75 | 80 | #define IEP2_REG_DIL_MODE(x) ((x) & 0xf) |
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| 81 | +#define IEP2_REG_TIMEOUT_CFG 0x0050 |
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| 82 | +#define IEP2_REG_TIMEOUT_CFG_EN BIT(31) |
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76 | 83 | #define IEP2_REG_DBG_FRM_CNT 0x0058 |
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77 | 84 | #define IEP2_REG_DBG_TIMEOUT_CNT 0x005c |
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78 | 85 | #define IEP2_REG_SRC_ADDR_CURY 0x0060 |
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