.. | .. |
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15 | 15 | #define PCI_VPD_ROM_SZ 7L<<14 /* VPD ROM size 0=256, 1=512, ... */ |
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16 | 16 | #define PCI_REV_DESC 1<<2 /* Reverse Descriptor bytes */ |
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17 | 17 | |
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18 | | -#define PCI_STATUS_ERROR_BITS (PCI_STATUS_DETECTED_PARITY | \ |
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19 | | - PCI_STATUS_SIG_SYSTEM_ERROR | \ |
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20 | | - PCI_STATUS_REC_MASTER_ABORT | \ |
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21 | | - PCI_STATUS_REC_TARGET_ABORT | \ |
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22 | | - PCI_STATUS_PARITY) |
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23 | | - |
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24 | 18 | enum csr_regs { |
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25 | 19 | B0_RAP = 0x0000, |
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26 | 20 | B0_CTST = 0x0004, |
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.. | .. |
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2426 | 2420 | spinlock_t phy_lock; |
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2427 | 2421 | struct tasklet_struct phy_task; |
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2428 | 2422 | |
---|
2429 | | - char irq_name[0]; /* skge@pci:000:04:00.0 */ |
---|
| 2423 | + char irq_name[]; /* skge@pci:000:04:00.0 */ |
---|
2430 | 2424 | }; |
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2431 | 2425 | |
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2432 | 2426 | enum pause_control { |
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