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| 3 | 3 | * Thunderbolt driver - NHI registers |
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| 4 | 4 | * |
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| 5 | 5 | * Copyright (c) 2014 Andreas Noever <andreas.noever@gmail.com> |
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| 6 | + * Copyright (C) 2018, Intel Corporation |
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| 6 | 7 | */ |
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| 7 | 8 | |
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| 8 | 9 | #ifndef NHI_REGS_H_ |
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| 123 | 124 | #define REG_FW_STS_ICM_EN_INVERT BIT(1) |
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| 124 | 125 | #define REG_FW_STS_ICM_EN BIT(0) |
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| 125 | 126 | |
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| 127 | +/* ICL NHI VSEC registers */ |
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| 128 | + |
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| 129 | +/* FW ready */ |
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| 130 | +#define VS_CAP_9 0xc8 |
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| 131 | +#define VS_CAP_9_FW_READY BIT(31) |
|---|
| 132 | +/* UUID */ |
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| 133 | +#define VS_CAP_10 0xcc |
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| 134 | +#define VS_CAP_11 0xd0 |
|---|
| 135 | +/* LTR */ |
|---|
| 136 | +#define VS_CAP_15 0xe0 |
|---|
| 137 | +#define VS_CAP_16 0xe4 |
|---|
| 138 | +/* TBT2PCIe */ |
|---|
| 139 | +#define VS_CAP_18 0xec |
|---|
| 140 | +#define VS_CAP_18_DONE BIT(0) |
|---|
| 141 | +/* PCIe2TBT */ |
|---|
| 142 | +#define VS_CAP_19 0xf0 |
|---|
| 143 | +#define VS_CAP_19_VALID BIT(0) |
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| 144 | +#define VS_CAP_19_CMD_SHIFT 1 |
|---|
| 145 | +#define VS_CAP_19_CMD_MASK GENMASK(7, 1) |
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| 146 | +/* Force power */ |
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| 147 | +#define VS_CAP_22 0xfc |
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| 148 | +#define VS_CAP_22_FORCE_POWER BIT(1) |
|---|
| 149 | +#define VS_CAP_22_DMA_DELAY_MASK GENMASK(31, 24) |
|---|
| 150 | +#define VS_CAP_22_DMA_DELAY_SHIFT 24 |
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| 151 | + |
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| 152 | +/** |
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| 153 | + * enum icl_lc_mailbox_cmd - ICL specific LC mailbox commands |
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| 154 | + * @ICL_LC_GO2SX: Ask LC to enter Sx without wake |
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| 155 | + * @ICL_LC_GO2SX_NO_WAKE: Ask LC to enter Sx with wake |
|---|
| 156 | + * @ICL_LC_PREPARE_FOR_RESET: Prepare LC for reset |
|---|
| 157 | + */ |
|---|
| 158 | +enum icl_lc_mailbox_cmd { |
|---|
| 159 | + ICL_LC_GO2SX = 0x02, |
|---|
| 160 | + ICL_LC_GO2SX_NO_WAKE = 0x03, |
|---|
| 161 | + ICL_LC_PREPARE_FOR_RESET = 0x21, |
|---|
| 162 | +}; |
|---|
| 163 | + |
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| 126 | 164 | #endif |
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