huangcm
2025-08-30 0269911b91ed7e03c24005924cc6423abf245fb8
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
#ifndef _UAPI_METAG_ECH_H
#define _UAPI_METAG_ECH_H
 
/*
 * These bits can be set in the top half of the D0.8 register when DSP context
 * switching is enabled, in order to support partial DSP context save/restore.
 */
 
#define TBICTX_XEXT_BIT    0x1000    /* Enable extended context save */
#define TBICTX_XTDP_BIT    0x0800    /* DSP accumulators/RAM/templates */
#define TBICTX_XHL2_BIT    0x0400    /* Hardware loops */
#define TBICTX_XAXX_BIT    0x0200    /* Extended AX registers (A*.4-7) */
#define TBICTX_XDX8_BIT    0x0100    /* Extended DX registers (D*.8-15) */
 
#endif /* _UAPI_METAG_ECH_H */