hc
2024-03-25 edb30157bad0c0001c32b854271ace01d3b9a16a
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
/** @file
 
Copyright (c) 2018, Intel Corporation. All rights reserved.<BR>
SPDX-License-Identifier: BSD-2-Clause-Patent
 
**/
 
#ifndef  _CPU_CSR_ACCESS_DEFINE_H_
#define  _CPU_CSR_ACCESS_DEFINE_H_
 
#include <SysHost.h>
#include <MemHost.h>
#include <Library/PcieAddress.h>
 
#include <CsrToPcieAddress.h>
#include <CpuPciAccessCommon.h>
 
 
typedef enum {
  BUS_CLASS = 0,
  DEVICE_CLASS = 1,
  FUNCTION_CLASS = 2
} BDF_CLASS;
 
UINT32
GetSegmentNumber (
  IN USRA_ADDRESS    *Address
  );
 
UINT32
GetBDFNumber (
  IN USRA_ADDRESS    *Address,
  CPU_CSR_ACCESS_VAR          *CpuCsrAccessVar,
  IN UINT8                    BDFType
  );
 
UINT32
GetCpuCsrAddress (
  UINT8    SocId,
  UINT8    BoxInst,
  UINT32   Offset,
  UINT8    *Size
  );
 
UINT32
GetMmcfgAddress(
  PSYSHOST host
  );
 
VOID
GetCpuCsrAccessVar_RC (
  PSYSHOST host,
  CPU_CSR_ACCESS_VAR *CpuCsrAccessVar
  );
 
#endif   // _CPU_CSR_ACCESS_DEFINE_H_