hc
2025-02-14 bbb9540dc49f70f6b703d1c8d1b85fa5f602d86e
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
/* SPDX-License-Identifier: GPL-2.0-only */
/*
 * Copyright (C) 2012 ARM Ltd.
 */
#ifndef __CLKSOURCE_ARM_ARCH_TIMER_H
#define __CLKSOURCE_ARM_ARCH_TIMER_H
 
#include <linux/bitops.h>
#include <linux/timecounter.h>
#include <linux/types.h>
 
#define ARCH_TIMER_TYPE_CP15        BIT(0)
#define ARCH_TIMER_TYPE_MEM        BIT(1)
 
#define ARCH_TIMER_CTRL_ENABLE        (1 << 0)
#define ARCH_TIMER_CTRL_IT_MASK        (1 << 1)
#define ARCH_TIMER_CTRL_IT_STAT        (1 << 2)
 
#define CNTHCTL_EL1PCTEN        (1 << 0)
#define CNTHCTL_EL1PCEN            (1 << 1)
#define CNTHCTL_EVNTEN            (1 << 2)
#define CNTHCTL_EVNTDIR            (1 << 3)
#define CNTHCTL_EVNTI            (0xF << 4)
 
enum arch_timer_reg {
   ARCH_TIMER_REG_CTRL,
   ARCH_TIMER_REG_TVAL,
};
 
enum arch_timer_ppi_nr {
   ARCH_TIMER_PHYS_SECURE_PPI,
   ARCH_TIMER_PHYS_NONSECURE_PPI,
   ARCH_TIMER_VIRT_PPI,
   ARCH_TIMER_HYP_PPI,
   ARCH_TIMER_MAX_TIMER_PPI
};
 
enum arch_timer_spi_nr {
   ARCH_TIMER_PHYS_SPI,
   ARCH_TIMER_VIRT_SPI,
   ARCH_TIMER_MAX_TIMER_SPI
};
 
#define ARCH_TIMER_PHYS_ACCESS        0
#define ARCH_TIMER_VIRT_ACCESS        1
#define ARCH_TIMER_MEM_PHYS_ACCESS    2
#define ARCH_TIMER_MEM_VIRT_ACCESS    3
 
#define ARCH_TIMER_MEM_MAX_FRAMES    8
 
#define ARCH_TIMER_USR_PCT_ACCESS_EN    (1 << 0) /* physical counter */
#define ARCH_TIMER_USR_VCT_ACCESS_EN    (1 << 1) /* virtual counter */
#define ARCH_TIMER_VIRT_EVT_EN        (1 << 2)
#define ARCH_TIMER_EVT_TRIGGER_SHIFT    (4)
#define ARCH_TIMER_EVT_TRIGGER_MASK    (0xF << ARCH_TIMER_EVT_TRIGGER_SHIFT)
#define ARCH_TIMER_USR_VT_ACCESS_EN    (1 << 8) /* virtual timer registers */
#define ARCH_TIMER_USR_PT_ACCESS_EN    (1 << 9) /* physical timer registers */
 
#define ARCH_TIMER_EVT_STREAM_PERIOD_US    100
#define ARCH_TIMER_EVT_STREAM_FREQ                \
   (USEC_PER_SEC / ARCH_TIMER_EVT_STREAM_PERIOD_US)
 
struct arch_timer_kvm_info {
   struct timecounter timecounter;
   int virtual_irq;
   int physical_irq;
};
 
struct arch_timer_mem_frame {
   bool valid;
   phys_addr_t cntbase;
   size_t size;
   int phys_irq;
   int virt_irq;
};
 
struct arch_timer_mem {
   phys_addr_t cntctlbase;
   size_t size;
   struct arch_timer_mem_frame frame[ARCH_TIMER_MEM_MAX_FRAMES];
};
 
#ifdef CONFIG_ARM_ARCH_TIMER
 
extern u32 arch_timer_get_rate(void);
extern u64 (*arch_timer_read_counter)(void);
extern struct arch_timer_kvm_info *arch_timer_get_kvm_info(void);
extern bool arch_timer_evtstrm_available(void);
 
#else
 
static inline u32 arch_timer_get_rate(void)
{
   return 0;
}
 
static inline u64 arch_timer_read_counter(void)
{
   return 0;
}
 
static inline bool arch_timer_evtstrm_available(void)
{
   return false;
}
 
#endif
 
#endif