/* SPDX-License-Identifier: GPL-2.0-only */
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#ifndef _DT_BINDINGS_CLK_MSM_GCC_8994_H
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#define _DT_BINDINGS_CLK_MSM_GCC_8994_H
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#define GPLL0_EARLY 0
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#define GPLL0 1
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#define GPLL4_EARLY 2
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#define GPLL4 3
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#define UFS_AXI_CLK_SRC 4
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#define USB30_MASTER_CLK_SRC 5
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#define BLSP1_QUP1_I2C_APPS_CLK_SRC 6
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#define GCC_USB_PHY_CFG_AHB2PHY_CLK 140
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/* GDSCs */
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#define PCIE_GDSC 0
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#define PCIE_0_GDSC 1
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#define PCIE_1_GDSC 2
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#define USB30_GDSC 3
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#define UFS_GDSC 4
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/* Resets */
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#define USB3_PHY_RESET 0
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#define USB3PHY_PHY_RESET 1
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#define PCIE_PHY_0_RESET 2
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#define PCIE_PHY_1_RESET 3
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#define QUSB2_PHY_RESET 4
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#endif
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