hc
2024-11-01 2f529f9b558ca1c1bd74be7437a84e4711743404
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
// SPDX-License-Identifier: GPL-2.0
/*
 * Generate definitions needed by assembly language modules.
 * This code generates raw asm output which is post-processed to extract
 * and format the required data.
 */
#define COMPILE_OFFSETS
 
#include <linux/crypto.h>
#include <linux/sched.h>
#include <linux/stddef.h>
#include <linux/hardirq.h>
#include <linux/suspend.h>
#include <linux/kbuild.h>
#include <asm/processor.h>
#include <asm/thread_info.h>
#include <asm/sigframe.h>
#include <asm/bootparam.h>
#include <asm/suspend.h>
#include <asm/tlbflush.h>
 
#ifdef CONFIG_XEN
#include <xen/interface/xen.h>
#endif
 
#ifdef CONFIG_X86_32
# include "asm-offsets_32.c"
#else
# include "asm-offsets_64.c"
#endif
 
static void __used common(void)
{
   BLANK();
   OFFSET(TASK_threadsp, task_struct, thread.sp);
#ifdef CONFIG_STACKPROTECTOR
   OFFSET(TASK_stack_canary, task_struct, stack_canary);
#endif
 
   BLANK();
#ifdef CONFIG_IRQ_PIPELINE
   DEFINE(OOB_stage_mask, STAGE_MASK);
#endif
   OFFSET(crypto_tfm_ctx_offset, crypto_tfm, __crt_ctx);
 
   BLANK();
   OFFSET(pbe_address, pbe, address);
   OFFSET(pbe_orig_address, pbe, orig_address);
   OFFSET(pbe_next, pbe, next);
 
#if defined(CONFIG_X86_32) || defined(CONFIG_IA32_EMULATION)
   BLANK();
   OFFSET(IA32_SIGCONTEXT_ax, sigcontext_32, ax);
   OFFSET(IA32_SIGCONTEXT_bx, sigcontext_32, bx);
   OFFSET(IA32_SIGCONTEXT_cx, sigcontext_32, cx);
   OFFSET(IA32_SIGCONTEXT_dx, sigcontext_32, dx);
   OFFSET(IA32_SIGCONTEXT_si, sigcontext_32, si);
   OFFSET(IA32_SIGCONTEXT_di, sigcontext_32, di);
   OFFSET(IA32_SIGCONTEXT_bp, sigcontext_32, bp);
   OFFSET(IA32_SIGCONTEXT_sp, sigcontext_32, sp);
   OFFSET(IA32_SIGCONTEXT_ip, sigcontext_32, ip);
 
   BLANK();
   OFFSET(IA32_RT_SIGFRAME_sigcontext, rt_sigframe_ia32, uc.uc_mcontext);
#endif
 
#ifdef CONFIG_PARAVIRT_XXL
   BLANK();
   OFFSET(PV_IRQ_irq_disable, paravirt_patch_template, irq.irq_disable);
   OFFSET(PV_IRQ_irq_enable, paravirt_patch_template, irq.irq_enable);
   OFFSET(PV_CPU_iret, paravirt_patch_template, cpu.iret);
   OFFSET(PV_MMU_read_cr2, paravirt_patch_template, mmu.read_cr2);
#endif
 
#ifdef CONFIG_XEN
   BLANK();
   OFFSET(XEN_vcpu_info_mask, vcpu_info, evtchn_upcall_mask);
   OFFSET(XEN_vcpu_info_pending, vcpu_info, evtchn_upcall_pending);
   OFFSET(XEN_vcpu_info_arch_cr2, vcpu_info, arch.cr2);
#endif
 
   BLANK();
   OFFSET(BP_scratch, boot_params, scratch);
   OFFSET(BP_secure_boot, boot_params, secure_boot);
   OFFSET(BP_loadflags, boot_params, hdr.loadflags);
   OFFSET(BP_hardware_subarch, boot_params, hdr.hardware_subarch);
   OFFSET(BP_version, boot_params, hdr.version);
   OFFSET(BP_kernel_alignment, boot_params, hdr.kernel_alignment);
   OFFSET(BP_init_size, boot_params, hdr.init_size);
   OFFSET(BP_pref_address, boot_params, hdr.pref_address);
 
   BLANK();
   DEFINE(PTREGS_SIZE, sizeof(struct pt_regs));
 
   /* TLB state for the entry code */
   OFFSET(TLB_STATE_user_pcid_flush_mask, tlb_state, user_pcid_flush_mask);
 
   /* Layout info for cpu_entry_area */
   OFFSET(CPU_ENTRY_AREA_entry_stack, cpu_entry_area, entry_stack_page);
   DEFINE(SIZEOF_entry_stack, sizeof(struct entry_stack));
   DEFINE(MASK_entry_stack, (~(sizeof(struct entry_stack) - 1)));
 
   /* Offset for fields in tss_struct */
   OFFSET(TSS_sp0, tss_struct, x86_tss.sp0);
   OFFSET(TSS_sp1, tss_struct, x86_tss.sp1);
   OFFSET(TSS_sp2, tss_struct, x86_tss.sp2);
}