hc
2023-02-13 e440ec23c5a540cdd3f7464e8779219be6fd3d95
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
/*
 * include/asm-mips/txx9tmr.h
 * TX39/TX49 timer controller definitions.
 *
 * This file is subject to the terms and conditions of the GNU General Public
 * License.  See the file "COPYING" in the main directory of this archive
 * for more details.
 */
#ifndef __ASM_TXX9TMR_H
#define __ASM_TXX9TMR_H
 
#include <linux/types.h>
 
struct txx9_tmr_reg {
   u32 tcr;
   u32 tisr;
   u32 cpra;
   u32 cprb;
   u32 itmr;
   u32 unused0[3];
   u32 ccdr;
   u32 unused1[3];
   u32 pgmr;
   u32 unused2[3];
   u32 wtmr;
   u32 unused3[43];
   u32 trr;
};
 
/* TMTCR : Timer Control */
#define TXx9_TMTCR_TCE        0x00000080
#define TXx9_TMTCR_CCDE        0x00000040
#define TXx9_TMTCR_CRE        0x00000020
#define TXx9_TMTCR_ECES        0x00000008
#define TXx9_TMTCR_CCS        0x00000004
#define TXx9_TMTCR_TMODE_MASK    0x00000003
#define TXx9_TMTCR_TMODE_ITVL    0x00000000
#define TXx9_TMTCR_TMODE_PGEN    0x00000001
#define TXx9_TMTCR_TMODE_WDOG    0x00000002
 
/* TMTISR : Timer Int. Status */
#define TXx9_TMTISR_TPIBS    0x00000004
#define TXx9_TMTISR_TPIAS    0x00000002
#define TXx9_TMTISR_TIIS    0x00000001
 
/* TMITMR : Interval Timer Mode */
#define TXx9_TMITMR_TIIE    0x00008000
#define TXx9_TMITMR_TZCE    0x00000001
 
/* TMWTMR : Watchdog Timer Mode */
#define TXx9_TMWTMR_TWIE    0x00008000
#define TXx9_TMWTMR_WDIS    0x00000080
#define TXx9_TMWTMR_TWC        0x00000001
 
void txx9_clocksource_init(unsigned long baseaddr,
              unsigned int imbusclk);
void txx9_clockevent_init(unsigned long baseaddr, int irq,
             unsigned int imbusclk);
void txx9_tmr_init(unsigned long baseaddr);
 
#ifdef CONFIG_CPU_TX39XX
#define TXX9_TIMER_BITS 24
#else
#define TXX9_TIMER_BITS 32
#endif
 
#endif /* __ASM_TXX9TMR_H */