hc
2023-10-16 def2367077573b56f9fc4f824e5c0377a3a4175a
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
/*
 * This program is free software; you can redistribute it and/or modify
 * it under the terms of the GNU General Public License as published by
 * the Free Software Foundation; either version 2 of the License, or
 * (at your option) any later version.
 *
 * This program is distributed in the hope that it will be useful,
 * but WITHOUT ANY WARRANTY; without even the implied warranty of
 * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
 *
 * GNU General Public License for more details.
 */
 
#include <linux/kernel.h>
#include <linux/init.h>
#include <linux/module.h>
#include <linux/types.h>
#include <linux/device.h>
#include <linux/string.h>
#include <linux/slab.h>
#include <linux/fs.h>
#include <linux/platform_device.h>
#include <linux/of.h>
#include <linux/of_address.h>
#include <linux/firmware.h>
#include <linux/io.h>
 
#include "io.h"
 
static inline void byte0_out(unsigned char data);
static inline void byte1_out(unsigned char data);
static inline void xl_cclk_b(int32_t i);
 
/* Assert and Deassert CCLK */
void xl_shift_cclk(int count)
{
   int i;
 
   for (i = 0; i < count; i++) {
       xl_cclk_b(1);
       xl_cclk_b(0);
   }
}
 
int xl_supported_prog_bus_width(enum wbus bus_bytes)
{
   switch (bus_bytes) {
   case bus_1byte:
       break;
   case bus_2byte:
       break;
   default:
       pr_err("unsupported program bus width %d\n",
               bus_bytes);
       return 0;
   }
 
   return 1;
}
 
/* Serialize byte and clock each bit on target's DIN and CCLK pins */
void xl_shift_bytes_out(enum wbus bus_byte, unsigned char *pdata)
{
   /*
    * supports 1 and 2 bytes programming mode
    */
   if (likely(bus_byte == bus_2byte))
       byte0_out(pdata[0]);
 
   byte1_out(pdata[1]);
   xl_shift_cclk(1);
}
 
/*
 * generic bit swap for xilinx SYSTEMMAP FPGA programming
 */
void xl_program_b(int32_t i)
{
}
 
void xl_rdwr_b(int32_t i)
{
}
 
void xl_csi_b(int32_t i)
{
}
 
int xl_get_init_b(void)
{
   return -1;
}
 
int xl_get_done_b(void)
{
   return -1;
}
 
static inline void byte0_out(unsigned char data)
{
}
 
static inline void byte1_out(unsigned char data)
{
}
 
static inline void xl_cclk_b(int32_t i)
{
}
 
/*
 * configurable per device type for different I/O config
 */
int xl_init_io(void)
{
   return -1;
}