hc
2023-02-18 84d1d1bed0120e0921c876885ca9006fb9ddf42e
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
* Marvell Armada 7K/8K PCIe interface
 
This PCIe host controller is based on the Synopsys DesignWare PCIe IP
and thus inherits all the common properties defined in designware-pcie.txt.
 
Required properties:
- compatible: "marvell,armada8k-pcie"
- reg: must contain two register regions
   - the control register region
   - the config space region
- reg-names:
   - "ctrl" for the control register region
   - "config" for the config space region
- interrupts: Interrupt specifier for the PCIe controler
- clocks: reference to the PCIe controller clocks
- clock-names: mandatory if there is a second clock, in this case the
   name must be "core" for the first clock and "reg" for the second
   one
 
Example:
 
   pcie@f2600000 {
       compatible = "marvell,armada8k-pcie", "snps,dw-pcie";
       reg = <0 0xf2600000 0 0x10000>, <0 0xf6f00000 0 0x80000>;
       reg-names = "ctrl", "config";
       #address-cells = <3>;
       #size-cells = <2>;
       #interrupt-cells = <1>;
       device_type = "pci";
       dma-coherent;
 
       bus-range = <0 0xff>;
       ranges = <0x81000000 0 0xf9000000 0  0xf9000000 0 0x10000    /* downstream I/O */
             0x82000000 0 0xf6000000 0  0xf6000000 0 0xf00000>;    /* non-prefetchable memory */
       interrupt-map-mask = <0 0 0 0>;
       interrupt-map = <0 0 0 0 &gic 0 GIC_SPI 32 IRQ_TYPE_LEVEL_HIGH>;
       interrupts = <GIC_SPI 32 IRQ_TYPE_LEVEL_HIGH>;
       num-lanes = <1>;
       clocks = <&cpm_syscon0 1 13>;
   };