add wifi6 8852be driver

hc

2024-12-19 9370bb92b2d16684ee45cf24e879c93c509162da

1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
#include <common.h>
#include <netdev.h>
#include <miiphy.h>
#include <asm/gpio.h>
#include <asm/io.h>
#include <asm/arch/clock.h>
#include <asm/arch/gpio.h>
 
void eth_init_board(void)
{
    int pin;
    struct sunxi_ccm_reg *const ccm =
        (struct sunxi_ccm_reg *)SUNXI_CCM_BASE;
 
    /* Set up clock gating */
#ifdef CONFIG_SUNXI_GEN_SUN6I
    setbits_le32(&ccm->ahb_reset0_cfg, 0x1 << AHB_RESET_OFFSET_GMAC);
    setbits_le32(&ccm->ahb_gate0, 0x1 << AHB_GATE_OFFSET_GMAC);
#else
    setbits_le32(&ccm->ahb_gate1, 0x1 << AHB_GATE_OFFSET_GMAC);
#endif
 
    /* Set MII clock */
#ifdef CONFIG_RGMII
    setbits_le32(&ccm->gmac_clk_cfg, CCM_GMAC_CTRL_TX_CLK_SRC_INT_RGMII |
        CCM_GMAC_CTRL_GPIT_RGMII);
    setbits_le32(&ccm->gmac_clk_cfg,
             CCM_GMAC_CTRL_TX_CLK_DELAY(CONFIG_GMAC_TX_DELAY));
#else
    setbits_le32(&ccm->gmac_clk_cfg, CCM_GMAC_CTRL_TX_CLK_SRC_MII |
        CCM_GMAC_CTRL_GPIT_MII);
#endif
 
#ifndef CONFIG_MACH_SUN6I
    /* Configure pin mux settings for GMAC */
    for (pin = SUNXI_GPA(0); pin <= SUNXI_GPA(16); pin++) {
#ifdef CONFIG_RGMII
        /* skip unused pins in RGMII mode */
        if (pin == SUNXI_GPA(9) || pin == SUNXI_GPA(14))
            continue;
#endif
        sunxi_gpio_set_cfgpin(pin, SUN7I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 3);
    }
#elif defined CONFIG_RGMII
    /* Configure sun6i RGMII mode pin mux settings */
    for (pin = SUNXI_GPA(0); pin <= SUNXI_GPA(3); pin++) {
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 3);
    }
    for (pin = SUNXI_GPA(9); pin <= SUNXI_GPA(14); pin++) {
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 3);
    }
    for (pin = SUNXI_GPA(19); pin <= SUNXI_GPA(20); pin++) {
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 3);
    }
    for (pin = SUNXI_GPA(25); pin <= SUNXI_GPA(27); pin++) {
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 3);
    }
#elif defined CONFIG_GMII
    /* Configure sun6i GMII mode pin mux settings */
    for (pin = SUNXI_GPA(0); pin <= SUNXI_GPA(27); pin++) {
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
        sunxi_gpio_set_drv(pin, 2);
    }
#else
    /* Configure sun6i MII mode pin mux settings */
    for (pin = SUNXI_GPA(0); pin <= SUNXI_GPA(3); pin++)
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
    for (pin = SUNXI_GPA(8); pin <= SUNXI_GPA(9); pin++)
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
    for (pin = SUNXI_GPA(11); pin <= SUNXI_GPA(14); pin++)
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
    for (pin = SUNXI_GPA(19); pin <= SUNXI_GPA(24); pin++)
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
    for (pin = SUNXI_GPA(26); pin <= SUNXI_GPA(27); pin++)
        sunxi_gpio_set_cfgpin(pin, SUN6I_GPA_GMAC);
#endif
}