hc
2024-12-19 9370bb92b2d16684ee45cf24e879c93c509162da
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
/*
 * Copyright (C) 2012 Vikram Narayananan
 * <vikram186@gmail.com>
 * (C) Copyright 2012,2015 Stephen Warren
 *
 * SPDX-License-Identifier:    GPL-2.0+
 */
 
#ifndef _BCM2835_GPIO_H_
#define _BCM2835_GPIO_H_
 
#define BCM2835_GPIO_COUNT        54
 
#define BCM2835_GPIO_FSEL_MASK        0x7
#define BCM2835_GPIO_INPUT        0x0
#define BCM2835_GPIO_OUTPUT        0x1
#define BCM2835_GPIO_ALT0        0x4
#define BCM2835_GPIO_ALT1        0x5
#define BCM2835_GPIO_ALT2        0x6
#define BCM2835_GPIO_ALT3        0x7
#define BCM2835_GPIO_ALT4        0x3
#define BCM2835_GPIO_ALT5        0x2
 
#define BCM2835_GPIO_COMMON_BANK(gpio)    ((gpio < 32) ? 0 : 1)
#define BCM2835_GPIO_COMMON_SHIFT(gpio)    (gpio & 0x1f)
 
#define BCM2835_GPIO_FSEL_BANK(gpio)    (gpio / 10)
#define BCM2835_GPIO_FSEL_SHIFT(gpio)    ((gpio % 10) * 3)
 
struct bcm2835_gpio_regs {
   u32 gpfsel[6];
   u32 reserved1;
   u32 gpset[2];
   u32 reserved2;
   u32 gpclr[2];
   u32 reserved3;
   u32 gplev[2];
   u32 reserved4;
   u32 gpeds[2];
   u32 reserved5;
   u32 gpren[2];
   u32 reserved6;
   u32 gpfen[2];
   u32 reserved7;
   u32 gphen[2];
   u32 reserved8;
   u32 gplen[2];
   u32 reserved9;
   u32 gparen[2];
   u32 reserved10;
   u32 gppud;
   u32 gppudclk[2];
};
 
/**
 * struct bcm2835_gpio_platdata - GPIO platform description
 *
 * @base: Base address of GPIO controller
 */
struct bcm2835_gpio_platdata {
   unsigned long base;
};
 
int bcm2835_gpio_get_func_id(struct udevice *dev, unsigned gpio);
 
#endif /* _BCM2835_GPIO_H_ */