hc
2024-12-19 9370bb92b2d16684ee45cf24e879c93c509162da
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
/*
 * (C) Copyright 2010
 * Marvell Semiconductor <www.marvell.com>
 * Written-by: Prafulla Wadaskar <prafulla@marvell.com>,
 * Contributor: Mahavir Jain <mjain@marvell.com>
 *
 * SPDX-License-Identifier:    GPL-2.0+
 */
 
#include <common.h>
#include <asm/io.h>
#include <asm/arch/armada100.h>
 
DECLARE_GLOBAL_DATA_PTR;
 
/*
 * ARMADA100 DRAM controller supports upto 8 banks
 * for chip select 0 and 1
 */
 
/*
 * DDR Memory Control Registers
 * Refer Datasheet Appendix A.17
 */
struct armd1ddr_map_registers {
   u32    cs;    /* Memory Address Map Register -CS */
   u32    pad[3];
};
 
struct armd1ddr_registers {
   u8    pad[0x100 - 0x000];
   struct armd1ddr_map_registers mmap[2];
};
 
/*
 * armd1_sdram_base - reads SDRAM Base Address Register
 */
u32 armd1_sdram_base(int chip_sel)
{
   struct armd1ddr_registers *ddr_regs =
       (struct armd1ddr_registers *)ARMD1_DRAM_BASE;
   u32 result = 0;
   u32 CS_valid = 0x01 & readl(&ddr_regs->mmap[chip_sel].cs);
 
   if (!CS_valid)
       return 0;
 
   result = readl(&ddr_regs->mmap[chip_sel].cs) & 0xFF800000;
   return result;
}
 
/*
 * armd1_sdram_size - reads SDRAM size
 */
u32 armd1_sdram_size(int chip_sel)
{
   struct armd1ddr_registers *ddr_regs =
       (struct armd1ddr_registers *)ARMD1_DRAM_BASE;
   u32 result = 0;
   u32 CS_valid = 0x01 & readl(&ddr_regs->mmap[chip_sel].cs);
 
   if (!CS_valid)
       return 0;
 
   result = readl(&ddr_regs->mmap[chip_sel].cs);
   result = (result >> 16) & 0xF;
   if (result < 0x7) {
       printf("Unknown DRAM Size\n");
       return -1;
   } else {
       return ((0x8 << (result - 0x7)) * 1024 * 1024);
   }
}
 
int dram_init(void)
{
   int i;
 
   gd->ram_size = 0;
   for (i = 0; i < CONFIG_NR_DRAM_BANKS; i++) {
       gd->bd->bi_dram[i].start = armd1_sdram_base(i);
       gd->bd->bi_dram[i].size = armd1_sdram_size(i);
       /*
        * It is assumed that all memory banks are consecutive
        * and without gaps.
        * If the gap is found, ram_size will be reported for
        * consecutive memory only
        */
       if (gd->bd->bi_dram[i].start != gd->ram_size)
           break;
 
       gd->ram_size += gd->bd->bi_dram[i].size;
 
   }
 
   for (; i < CONFIG_NR_DRAM_BANKS; i++) {
       /* If above loop terminated prematurely, we need to set
        * remaining banks' start address & size as 0. Otherwise other
        * u-boot functions and Linux kernel gets wrong values which
        * could result in crash */
       gd->bd->bi_dram[i].start = 0;
       gd->bd->bi_dram[i].size = 0;
   }
   return 0;
}
 
/*
 * If this function is not defined here,
 * board.c alters dram bank zero configuration defined above.
 */
int dram_init_banksize(void)
{
   dram_init();
 
   return 0;
}