hc
2024-12-19 9370bb92b2d16684ee45cf24e879c93c509162da
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
/* SPDX-License-Identifier: GPL-2.0-only */
/*
 * Copyright 2010 MontaVista Software, LLC.
 *
 * Author: Anton Vorontsov <avorontsov@ru.mvista.com>
 */
 
#ifndef _DRIVERS_MMC_SDHCI_PLTFM_H
#define _DRIVERS_MMC_SDHCI_PLTFM_H
 
#include <linux/clk.h>
#include <linux/platform_device.h>
#include "sdhci.h"
 
struct sdhci_pltfm_data {
   const struct sdhci_ops *ops;
   unsigned int quirks;
   unsigned int quirks2;
};
 
struct sdhci_pltfm_host {
   struct clk *clk;
 
   /* migrate from sdhci_of_host */
   unsigned int clock;
   u16 xfer_mode_shadow;
 
   unsigned long private[] ____cacheline_aligned;
};
 
#ifdef CONFIG_MMC_SDHCI_BIG_ENDIAN_32BIT_BYTE_SWAPPER
/*
 * These accessors are designed for big endian hosts doing I/O to
 * little endian controllers incorporating a 32-bit hardware byte swapper.
 */
static inline u32 sdhci_be32bs_readl(struct sdhci_host *host, int reg)
{
   return in_be32(host->ioaddr + reg);
}
 
static inline u16 sdhci_be32bs_readw(struct sdhci_host *host, int reg)
{
   return in_be16(host->ioaddr + (reg ^ 0x2));
}
 
static inline u8 sdhci_be32bs_readb(struct sdhci_host *host, int reg)
{
   return in_8(host->ioaddr + (reg ^ 0x3));
}
 
static inline void sdhci_be32bs_writel(struct sdhci_host *host,
                      u32 val, int reg)
{
   out_be32(host->ioaddr + reg, val);
}
 
static inline void sdhci_be32bs_writew(struct sdhci_host *host,
                      u16 val, int reg)
{
   struct sdhci_pltfm_host *pltfm_host = sdhci_priv(host);
   int base = reg & ~0x3;
   int shift = (reg & 0x2) * 8;
 
   switch (reg) {
   case SDHCI_TRANSFER_MODE:
       /*
        * Postpone this write, we must do it together with a
        * command write that is down below.
        */
       pltfm_host->xfer_mode_shadow = val;
       return;
   case SDHCI_COMMAND:
       sdhci_be32bs_writel(host,
                   val << 16 | pltfm_host->xfer_mode_shadow,
                   SDHCI_TRANSFER_MODE);
       return;
   }
   clrsetbits_be32(host->ioaddr + base, 0xffff << shift, val << shift);
}
 
static inline void sdhci_be32bs_writeb(struct sdhci_host *host, u8 val, int reg)
{
   int base = reg & ~0x3;
   int shift = (reg & 0x3) * 8;
 
   clrsetbits_be32(host->ioaddr + base , 0xff << shift, val << shift);
}
#endif /* CONFIG_MMC_SDHCI_BIG_ENDIAN_32BIT_BYTE_SWAPPER */
 
void sdhci_get_property(struct platform_device *pdev);
 
static inline void sdhci_get_of_property(struct platform_device *pdev)
{
   return sdhci_get_property(pdev);
}
 
extern struct sdhci_host *sdhci_pltfm_init(struct platform_device *pdev,
                     const struct sdhci_pltfm_data *pdata,
                     size_t priv_size);
extern void sdhci_pltfm_free(struct platform_device *pdev);
 
extern int sdhci_pltfm_register(struct platform_device *pdev,
               const struct sdhci_pltfm_data *pdata,
               size_t priv_size);
extern int sdhci_pltfm_unregister(struct platform_device *pdev);
 
extern unsigned int sdhci_pltfm_clk_get_max_clock(struct sdhci_host *host);
 
static inline void *sdhci_pltfm_priv(struct sdhci_pltfm_host *host)
{
   return host->private;
}
 
extern const struct dev_pm_ops sdhci_pltfm_pmops;
#ifdef CONFIG_PM_SLEEP
int sdhci_pltfm_suspend(struct device *dev);
int sdhci_pltfm_resume(struct device *dev);
#else
static inline int sdhci_pltfm_suspend(struct device *dev) { return 0; }
static inline int sdhci_pltfm_resume(struct device *dev) { return 0; }
#endif
 
#endif /* _DRIVERS_MMC_SDHCI_PLTFM_H */