hc
2023-11-22 f743a7adbd6e230d66a6206fa115b59fec2d88eb
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
/*
 * [origin: Linux kernel include/asm-arm/arch-at91/at91sam9260_matrix.h]
 *
 * Copyright (C) 2007 Atmel Corporation.
 *
 * Memory Controllers (MATRIX, EBI) - System peripherals registers.
 * Based on AT91SAM9260 datasheet revision B.
 *
 * SPDX-License-Identifier:    GPL-2.0+
 */
 
#ifndef AT91SAM9260_MATRIX_H
#define AT91SAM9260_MATRIX_H
 
#ifndef __ASSEMBLY__
 
/*
 * This struct defines access to the matrix' maximum of
 * 16 masters and 16 slaves.
 * However, on the AT91SAM9260/9G20/9XE there exist only
 * 6 Masters and 5 Slaves!
 */
struct at91_matrix {
   u32    mcfg[16];    /* Master Configuration Registers */
   u32    scfg[16];    /* Slave Configuration Registers */
   u32    pras[16][2];    /* Priority Assignment Slave Registers */
   u32    mrcr;        /* Master Remap Control Register */
   u32    filler[0x06];
   u32    ebicsa;        /* EBI Chip Select Assignment Register */
};
 
#endif /* __ASSEMBLY__ */
 
#define AT91_MATRIX_ULBT_INFINITE    (0 << 0)
#define AT91_MATRIX_ULBT_SINGLE        (1 << 0)
#define AT91_MATRIX_ULBT_FOUR        (2 << 0)
#define AT91_MATRIX_ULBT_EIGHT        (3 << 0)
#define AT91_MATRIX_ULBT_SIXTEEN    (4 << 0)
 
#define AT91_MATRIX_DEFMSTR_TYPE_NONE    (0 << 16)
#define AT91_MATRIX_DEFMSTR_TYPE_LAST    (1 << 16)
#define AT91_MATRIX_DEFMSTR_TYPE_FIXED    (2 << 16)
#define AT91_MATRIX_FIXED_DEFMSTR_SHIFT    18
#define AT91_MATRIX_ARBT_ROUND_ROBIN    (0 << 24)
#define AT91_MATRIX_ARBT_FIXED_PRIORITY    (1 << 24)
 
#define AT91_MATRIX_M0PR_SHIFT        0
#define AT91_MATRIX_M1PR_SHIFT        4
#define AT91_MATRIX_M2PR_SHIFT        8
#define AT91_MATRIX_M3PR_SHIFT        12
#define AT91_MATRIX_M4PR_SHIFT        16
#define AT91_MATRIX_M5PR_SHIFT        20
 
#define AT91_MATRIX_RCB0        (1 << 0)
#define AT91_MATRIX_RCB1        (1 << 1)
 
#define AT91_MATRIX_CS1A_SDRAMC        (1 << 1)
#define AT91_MATRIX_CS3A_SMC_SMARTMEDIA    (1 << 3)
#define AT91_MATRIX_CS4A_SMC_CF1    (1 << 4)
#define AT91_MATRIX_CS5A_SMC_CF2    (1 << 5)
#define AT91_MATRIX_DBPUC        (1 << 8)
#define AT91_MATRIX_VDDIOMSEL_1_8V    (0 << 16)
#define AT91_MATRIX_VDDIOMSEL_3_3V    (1 << 16)
#define AT91_MATRIX_EBI_IOSR_SEL    (1 << 17)
 
/* Maximum Number of Allowed Cycles for a Burst */
#define AT91_MATRIX_SLOT_CYCLE        (0xff << 0)
#define AT91_MATRIX_SLOT_CYCLE_(x)    (x << 0)
 
#endif