hc
2023-11-22 f743a7adbd6e230d66a6206fa115b59fec2d88eb
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
/*
 * Copyright (C) 2013 Boundary Devices Inc.
 *
 * SPDX-License-Identifier:    GPL-2.0+
 */
#ifndef __ASM_ARCH_MX6Q_DDR_H__
#define __ASM_ARCH_MX6Q_DDR_H__
 
#ifndef CONFIG_MX6Q
#error "wrong CPU"
#endif
 
#define MX6_IOM_DRAM_DQM0    0x020e05ac
#define MX6_IOM_DRAM_DQM1    0x020e05b4
#define MX6_IOM_DRAM_DQM2    0x020e0528
#define MX6_IOM_DRAM_DQM3    0x020e0520
#define MX6_IOM_DRAM_DQM4    0x020e0514
#define MX6_IOM_DRAM_DQM5    0x020e0510
#define MX6_IOM_DRAM_DQM6    0x020e05bc
#define MX6_IOM_DRAM_DQM7    0x020e05c4
 
#define MX6_IOM_DRAM_CAS    0x020e056c
#define MX6_IOM_DRAM_RAS    0x020e0578
#define MX6_IOM_DRAM_RESET    0x020e057c
#define MX6_IOM_DRAM_SDCLK_0    0x020e0588
#define MX6_IOM_DRAM_SDCLK_1    0x020e0594
#define MX6_IOM_DRAM_SDBA2    0x020e058c
#define MX6_IOM_DRAM_SDCKE0    0x020e0590
#define MX6_IOM_DRAM_SDCKE1    0x020e0598
#define MX6_IOM_DRAM_SDODT0    0x020e059c
#define MX6_IOM_DRAM_SDODT1    0x020e05a0
 
#define MX6_IOM_DRAM_SDQS0    0x020e05a8
#define MX6_IOM_DRAM_SDQS1    0x020e05b0
#define MX6_IOM_DRAM_SDQS2    0x020e0524
#define MX6_IOM_DRAM_SDQS3    0x020e051c
#define MX6_IOM_DRAM_SDQS4    0x020e0518
#define MX6_IOM_DRAM_SDQS5    0x020e050c
#define MX6_IOM_DRAM_SDQS6    0x020e05b8
#define MX6_IOM_DRAM_SDQS7    0x020e05c0
 
#define MX6_IOM_GRP_B0DS    0x020e0784
#define MX6_IOM_GRP_B1DS    0x020e0788
#define MX6_IOM_GRP_B2DS    0x020e0794
#define MX6_IOM_GRP_B3DS    0x020e079c
#define MX6_IOM_GRP_B4DS    0x020e07a0
#define MX6_IOM_GRP_B5DS    0x020e07a4
#define MX6_IOM_GRP_B6DS    0x020e07a8
#define MX6_IOM_GRP_B7DS    0x020e0748
#define MX6_IOM_GRP_ADDDS    0x020e074c
#define MX6_IOM_DDRMODE_CTL    0x020e0750
#define MX6_IOM_GRP_DDRPKE    0x020e0758
#define MX6_IOM_GRP_DDRMODE    0x020e0774
#define MX6_IOM_GRP_CTLDS    0x020e078c
#define MX6_IOM_GRP_DDR_TYPE    0x020e0798
 
#endif    /*__ASM_ARCH_MX6Q_DDR_H__ */