hc
2023-11-22 f743a7adbd6e230d66a6206fa115b59fec2d88eb
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
/*
 * cs35l32.h -- CS35L32 ALSA SoC audio driver
 *
 * Copyright 2014 CirrusLogic, Inc.
 *
 * Author: Brian Austin <brian.austin@cirrus.com>
 *
 * This program is free software; you can redistribute it and/or modify
 * it under the terms of the GNU General Public License version 2 as
 * published by the Free Software Foundation.
 *
 */
 
#ifndef __CS35L32_H__
#define __CS35L32_H__
 
struct cs35l32_platform_data {
   /* Low Battery Threshold */
   unsigned int batt_thresh;
   /* Low Battery Recovery */
   unsigned int batt_recov;
   /* LED Current Management*/
   unsigned int led_mng;
   /* Audio Gain w/ LED */
   unsigned int audiogain_mng;
   /* Boost Management */
   unsigned int boost_mng;
   /* Data CFG for DUAL device */
   unsigned int sdout_datacfg;
   /* SDOUT Sharing */
   unsigned int sdout_share;
};
 
#define CS35L32_CHIP_ID        0x00035A32
#define CS35L32_DEVID_AB    0x01    /* Device ID A & B [RO] */
#define CS35L32_DEVID_CD    0x02    /* Device ID C & D [RO] */
#define CS35L32_DEVID_E        0x03    /* Device ID E [RO] */
#define CS35L32_FAB_ID        0x04    /* Fab ID [RO] */
#define CS35L32_REV_ID        0x05    /* Revision ID [RO] */
#define CS35L32_PWRCTL1        0x06    /* Power Ctl 1 */
#define CS35L32_PWRCTL2        0x07    /* Power Ctl 2 */
#define CS35L32_CLK_CTL        0x08    /* Clock Ctl */
#define CS35L32_BATT_THRESHOLD    0x09    /* Low Battery Threshold */
#define CS35L32_VMON        0x0A    /* Voltage Monitor [RO] */
#define CS35L32_BST_CPCP_CTL    0x0B    /* Conv Peak Curr Protection CTL */
#define CS35L32_IMON_SCALING    0x0C    /* IMON Scaling */
#define CS35L32_AUDIO_LED_MNGR    0x0D    /* Audio/LED Pwr Manager */
#define CS35L32_ADSP_CTL    0x0F    /* Serial Port Control */
#define CS35L32_CLASSD_CTL    0x10    /* Class D Amp CTL */
#define CS35L32_PROTECT_CTL    0x11    /* Protection Release CTL */
#define CS35L32_INT_MASK_1    0x12    /* Interrupt Mask 1 */
#define CS35L32_INT_MASK_2    0x13    /* Interrupt Mask 2 */
#define CS35L32_INT_MASK_3    0x14    /* Interrupt Mask 3 */
#define CS35L32_INT_STATUS_1    0x15    /* Interrupt Status 1 [RO] */
#define CS35L32_INT_STATUS_2    0x16    /* Interrupt Status 2 [RO] */
#define CS35L32_INT_STATUS_3    0x17    /* Interrupt Status 3 [RO] */
#define CS35L32_LED_STATUS    0x18    /* LED Lighting Status [RO] */
#define CS35L32_FLASH_MODE    0x19    /* LED Flash Mode Current */
#define CS35L32_MOVIE_MODE    0x1A    /* LED Movie Mode Current */
#define CS35L32_FLASH_TIMER    0x1B    /* LED Flash Timer */
#define CS35L32_FLASH_INHIBIT    0x1C    /* LED Flash Inhibit Current */
#define CS35L32_MAX_REGISTER    0x1C
 
#define CS35L32_MCLK_DIV2    0x01
#define CS35L32_MCLK_RATIO    0x01
#define CS35L32_MCLKDIS        0x80
#define CS35L32_PDN_ALL        0x01
#define CS35L32_PDN_AMP        0x80
#define CS35L32_PDN_BOOST    0x04
#define CS35L32_PDN_IMON    0x40
#define CS35L32_PDN_VMON    0x80
#define CS35L32_PDN_VPMON    0x20
#define CS35L32_PDN_ADSP    0x08
 
#define CS35L32_MCLK_DIV2_MASK        0x40
#define CS35L32_MCLK_RATIO_MASK        0x01
#define CS35L32_MCLK_MASK        0x41
#define CS35L32_ADSP_MASTER_MASK    0x40
#define CS35L32_BOOST_MASK        0x03
#define CS35L32_GAIN_MGR_MASK        0x08
#define CS35L32_ADSP_SHARE_MASK        0x08
#define CS35L32_ADSP_DATACFG_MASK    0x30
#define CS35L32_SDOUT_3ST        0x08
#define CS35L32_BATT_REC_MASK        0x0E
#define CS35L32_BATT_THRESH_MASK    0x30
 
#define CS35L32_RATES (SNDRV_PCM_RATE_48000)
#define CS35L32_FORMATS (SNDRV_PCM_FMTBIT_S16_LE | \
           SNDRV_PCM_FMTBIT_S24_LE | \
           SNDRV_PCM_FMTBIT_S32_LE)
 
 
#endif