disable pwm7

hc

2023-11-22 f743a7adbd6e230d66a6206fa115b59fec2d88eb

1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
/*
 * Second generation of pinmux driver for Amlogic Meson-AXG SoC.
 *
 * Copyright (c) 2017 Baylibre SAS.
 * Author:  Jerome Brunet  <jbrunet@baylibre.com>
 *
 * Copyright (c) 2017 Amlogic, Inc. All rights reserved.
 * Author: Xingyu Chen <xingyu.chen@amlogic.com>
 *
 * SPDX-License-Identifier: (GPL-2.0+ or MIT)
 */
 
/*
 * This new generation of pinctrl IP is mainly adopted by the
 * Meson-AXG SoC and later series, which use 4-width continuous
 * register bit to select the function for each pin.
 *
 * The value 0 is always selecting the GPIO mode, while other
 * values (start from 1) for selecting the function mode.
 */
#include <linux/device.h>
#include <linux/regmap.h>
#include <linux/pinctrl/pinctrl.h>
#include <linux/pinctrl/pinmux.h>
 
#include "pinctrl-meson.h"
#include "pinctrl-meson-axg-pmx.h"
 
static int meson_axg_pmx_get_bank(struct meson_pinctrl *pc,
            unsigned int pin,
            struct meson_pmx_bank **bank)
{
    int i;
    struct meson_axg_pmx_data *pmx = pc->data->pmx_data;
 
    for (i = 0; i < pmx->num_pmx_banks; i++)
        if (pin >= pmx->pmx_banks[i].first &&
                pin <= pmx->pmx_banks[i].last) {
            *bank = &pmx->pmx_banks[i];
            return 0;
        }
 
    return -EINVAL;
}
 
static int meson_pmx_calc_reg_and_offset(struct meson_pmx_bank *bank,
            unsigned int pin, unsigned int *reg,
            unsigned int *offset)
{
    int shift;
 
    shift = pin - bank->first;
 
    *reg = bank->reg + (bank->offset + (shift << 2)) / 32;
    *offset = (bank->offset + (shift << 2)) % 32;
 
    return 0;
}
 
static int meson_axg_pmx_update_function(struct meson_pinctrl *pc,
            unsigned int pin, unsigned int func)
{
    int ret;
    int reg;
    int offset;
    struct meson_pmx_bank *bank;
 
    ret = meson_axg_pmx_get_bank(pc, pin, &bank);
    if (ret)
        return ret;
 
    meson_pmx_calc_reg_and_offset(bank, pin, &reg, &offset);
 
    ret = regmap_update_bits(pc->reg_mux, reg << 2,
        0xf << offset, (func & 0xf) << offset);
 
    return ret;
}
 
static int meson_axg_pmx_set_mux(struct pinctrl_dev *pcdev,
            unsigned int func_num, unsigned int group_num)
{
    int i;
    int ret;
    struct meson_pinctrl *pc = pinctrl_dev_get_drvdata(pcdev);
    struct meson_pmx_func *func = &pc->data->funcs[func_num];
    struct meson_pmx_group *group = &pc->data->groups[group_num];
    struct meson_pmx_axg_data *pmx_data =
        (struct meson_pmx_axg_data *)group->data;
 
    dev_dbg(pc->dev, "enable function %s, group %s\n", func->name,
        group->name);
 
    for (i = 0; i < group->num_pins; i++) {
        ret = meson_axg_pmx_update_function(pc, group->pins[i],
            pmx_data->func);
        if (ret)
            return ret;
    }
 
    return 0;
}
 
static int meson_axg_pmx_request_gpio(struct pinctrl_dev *pcdev,
            struct pinctrl_gpio_range *range, unsigned int offset)
{
    struct meson_pinctrl *pc = pinctrl_dev_get_drvdata(pcdev);
 
    return meson_axg_pmx_update_function(pc, offset, 0);
}
 
const struct pinmux_ops meson_axg_pmx_ops = {
    .set_mux = meson_axg_pmx_set_mux,
    .get_functions_count = meson_pmx_get_funcs_count,
    .get_function_name = meson_pmx_get_func_name,
    .get_function_groups = meson_pmx_get_groups,
    .gpio_request_enable = meson_axg_pmx_request_gpio,
};