rk3568 rt init

hc

2023-11-06 e3e12f52b214121840b44c91de5b3e5af5d3eb84

1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
/* SPDX-License-Identifier: GPL-2.0 */
#ifndef __ASMARM_ARCH_TIMER_H
#define __ASMARM_ARCH_TIMER_H
 
#include <asm/barrier.h>
#include <asm/errno.h>
#include <linux/clocksource.h>
#include <linux/init.h>
#include <linux/types.h>
 
#include <clocksource/arm_arch_timer.h>
 
#ifdef CONFIG_ARM_ARCH_TIMER
int arch_timer_arch_init(void);
 
/*
 * These register accessors are marked inline so the compiler can
 * nicely work out which register we want, and chuck away the rest of
 * the code. At least it does so with a recent GCC (4.6.3).
 */
static __always_inline
void arch_timer_reg_write_cp15(int access, enum arch_timer_reg reg, u32 val)
{
    if (access == ARCH_TIMER_PHYS_ACCESS) {
        switch (reg) {
        case ARCH_TIMER_REG_CTRL:
            asm volatile("mcr p15, 0, %0, c14, c2, 1" : : "r" (val));
            break;
        case ARCH_TIMER_REG_TVAL:
            asm volatile("mcr p15, 0, %0, c14, c2, 0" : : "r" (val));
            break;
        }
    } else if (access == ARCH_TIMER_VIRT_ACCESS) {
        switch (reg) {
        case ARCH_TIMER_REG_CTRL:
            asm volatile("mcr p15, 0, %0, c14, c3, 1" : : "r" (val));
            break;
        case ARCH_TIMER_REG_TVAL:
            asm volatile("mcr p15, 0, %0, c14, c3, 0" : : "r" (val));
            break;
        }
    }
 
    isb();
}
 
static __always_inline
u32 arch_timer_reg_read_cp15(int access, enum arch_timer_reg reg)
{
    u32 val = 0;
 
    if (access == ARCH_TIMER_PHYS_ACCESS) {
        switch (reg) {
        case ARCH_TIMER_REG_CTRL:
            asm volatile("mrc p15, 0, %0, c14, c2, 1" : "=r" (val));
            break;
        case ARCH_TIMER_REG_TVAL:
            asm volatile("mrc p15, 0, %0, c14, c2, 0" : "=r" (val));
            break;
        }
    } else if (access == ARCH_TIMER_VIRT_ACCESS) {
        switch (reg) {
        case ARCH_TIMER_REG_CTRL:
            asm volatile("mrc p15, 0, %0, c14, c3, 1" : "=r" (val));
            break;
        case ARCH_TIMER_REG_TVAL:
            asm volatile("mrc p15, 0, %0, c14, c3, 0" : "=r" (val));
            break;
        }
    }
 
    return val;
}
 
static inline u32 arch_timer_get_cntfrq(void)
{
    u32 val;
    asm volatile("mrc p15, 0, %0, c14, c0, 0" : "=r" (val));
    return val;
}
 
static inline u64 arch_counter_get_cntpct(void)
{
    u64 cval;
 
    isb();
    asm volatile("mrrc p15, 0, %Q0, %R0, c14" : "=r" (cval));
    return cval;
}
 
static inline u64 arch_counter_get_cntvct(void)
{
    u64 cval;
 
    isb();
    asm volatile("mrrc p15, 1, %Q0, %R0, c14" : "=r" (cval));
    return cval;
}
 
static inline u32 arch_timer_get_cntkctl(void)
{
    u32 cntkctl;
    asm volatile("mrc p15, 0, %0, c14, c1, 0" : "=r" (cntkctl));
    return cntkctl;
}
 
static inline void arch_timer_set_cntkctl(u32 cntkctl)
{
    asm volatile("mcr p15, 0, %0, c14, c1, 0" : : "r" (cntkctl));
    isb();
}
 
#endif
 
#endif