hc
2023-12-09 b22da3d8526a935aa31e086e63f60ff3246cb61c
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
/*
 * Utility to set the DAVINCI MUX register from a table in mux.h
 *
 * Author: Vladimir Barinov, MontaVista Software, Inc. <source@mvista.com>
 *
 * Based on linux/arch/arm/plat-omap/mux.c:
 * Copyright (C) 2003 - 2005 Nokia Corporation
 *
 * Written by Tony Lindgren
 *
 * 2007 (c) MontaVista Software, Inc. This file is licensed under
 * the terms of the GNU General Public License version 2. This program
 * is licensed "as is" without any warranty of any kind, whether express
 * or implied.
 *
 * Copyright (C) 2008 Texas Instruments.
 */
 
#define pr_fmt(fmt) KBUILD_MODNAME ": " fmt
 
#include <linux/io.h>
#include <linux/module.h>
#include <linux/spinlock.h>
 
#include <mach/mux.h>
#include <mach/common.h>
 
static void __iomem *pinmux_base;
 
/*
 * Sets the DAVINCI MUX register based on the table
 */
int davinci_cfg_reg(const unsigned long index)
{
   static DEFINE_SPINLOCK(mux_spin_lock);
   struct davinci_soc_info *soc_info = &davinci_soc_info;
   unsigned long flags;
   const struct mux_config *cfg;
   unsigned int reg_orig = 0, reg = 0;
   unsigned int mask, warn = 0;
 
   if (WARN_ON(!soc_info->pinmux_pins))
       return -ENODEV;
 
   if (!pinmux_base) {
       pinmux_base = ioremap(soc_info->pinmux_base, SZ_4K);
       if (WARN_ON(!pinmux_base))
           return -ENOMEM;
   }
 
   if (index >= soc_info->pinmux_pins_num) {
       pr_err("Invalid pin mux index: %lu (%lu)\n",
              index, soc_info->pinmux_pins_num);
       dump_stack();
       return -ENODEV;
   }
 
   cfg = &soc_info->pinmux_pins[index];
 
   if (cfg->name == NULL) {
       pr_err("No entry for the specified index\n");
       return -ENODEV;
   }
 
   /* Update the mux register in question */
   if (cfg->mask) {
       unsigned    tmp1, tmp2;
 
       spin_lock_irqsave(&mux_spin_lock, flags);
       reg_orig = __raw_readl(pinmux_base + cfg->mux_reg);
 
       mask = (cfg->mask << cfg->mask_offset);
       tmp1 = reg_orig & mask;
       reg = reg_orig & ~mask;
 
       tmp2 = (cfg->mode << cfg->mask_offset);
       reg |= tmp2;
 
       if (tmp1 != tmp2)
           warn = 1;
 
       __raw_writel(reg, pinmux_base + cfg->mux_reg);
       spin_unlock_irqrestore(&mux_spin_lock, flags);
   }
 
   if (warn) {
#ifdef CONFIG_DAVINCI_MUX_WARNINGS
       pr_warn("initialized %s\n", cfg->name);
#endif
   }
 
#ifdef CONFIG_DAVINCI_MUX_DEBUG
   if (cfg->debug || warn) {
       pr_warn("Setting register %s\n", cfg->name);
       pr_warn("   %s (0x%08x) = 0x%08x -> 0x%08x\n",
           cfg->mux_reg_name, cfg->mux_reg, reg_orig, reg);
   }
#endif
 
   return 0;
}
EXPORT_SYMBOL(davinci_cfg_reg);
 
int davinci_cfg_reg_list(const short pins[])
{
   int i, error = -EINVAL;
 
   if (pins)
       for (i = 0; pins[i] >= 0; i++) {
           error = davinci_cfg_reg(pins[i]);
           if (error)
               break;
       }
 
   return error;
}