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 */
 
#ifndef _ASM_RISCV_CACHEFLUSH_H
#define _ASM_RISCV_CACHEFLUSH_H
 
#include <asm-generic/cacheflush.h>
 
#undef flush_icache_range
#undef flush_icache_user_range
#undef flush_dcache_page
 
static inline void local_flush_icache_all(void)
{
   asm volatile ("fence.i" ::: "memory");
}
 
#define PG_dcache_clean PG_arch_1
 
static inline void flush_dcache_page(struct page *page)
{
   if (test_bit(PG_dcache_clean, &page->flags))
       clear_bit(PG_dcache_clean, &page->flags);
}
 
/*
 * RISC-V doesn't have an instruction to flush parts of the instruction cache,
 * so instead we just flush the whole thing.
 */
#define flush_icache_range(start, end) flush_icache_all()
#define flush_icache_user_range(vma, pg, addr, len) flush_icache_all()
 
#ifndef CONFIG_SMP
 
#define flush_icache_all() local_flush_icache_all()
#define flush_icache_mm(mm, local) flush_icache_all()
 
#else /* CONFIG_SMP */
 
#define flush_icache_all() sbi_remote_fence_i(NULL)
void flush_icache_mm(struct mm_struct *mm, bool local);
 
#endif /* CONFIG_SMP */
 
/*
 * Bits in sys_riscv_flush_icache()'s flags argument.
 */
#define SYS_RISCV_FLUSH_ICACHE_LOCAL 1UL
#define SYS_RISCV_FLUSH_ICACHE_ALL   (SYS_RISCV_FLUSH_ICACHE_LOCAL)
 
#endif /* _ASM_RISCV_CACHEFLUSH_H */