hc
2023-10-25 6c2073b7aa40e29d0eca7d571dd7bc590c7ecaa7
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
/*
 * This file is subject to the terms and conditions of the GNU General Public
 * License.  See the file "COPYING" in the main directory of this archive
 * for more details.
 *
 * Copyright (C) 1992 - 1997, 2000-2005 Silicon Graphics, Inc. All rights reserved.
 */
#ifndef _ASM_IA64_SN_PCI_PCIBUS_PROVIDER_H
#define _ASM_IA64_SN_PCI_PCIBUS_PROVIDER_H
 
/*
 * SN pci asic types.  Do not ever renumber these or reuse values.  The
 * values must agree with what prom thinks they are.
 */
 
#define PCIIO_ASIC_TYPE_UNKNOWN    0
#define PCIIO_ASIC_TYPE_PPB    1
#define PCIIO_ASIC_TYPE_PIC    2
#define PCIIO_ASIC_TYPE_TIOCP    3
#define PCIIO_ASIC_TYPE_TIOCA    4
#define PCIIO_ASIC_TYPE_TIOCE    5
 
#define PCIIO_ASIC_MAX_TYPES    6
 
/*
 * Common pciio bus provider data.  There should be one of these as the
 * first field in any pciio based provider soft structure (e.g. pcibr_soft
 * tioca_soft, etc).
 */
 
struct pcibus_bussoft {
   u32        bs_asic_type;    /* chipset type */
   u32        bs_xid;        /* xwidget id */
   u32        bs_persist_busnum; /* Persistent Bus Number */
   u32        bs_persist_segment; /* Segment Number */
   u64        bs_legacy_io;    /* legacy io pio addr */
   u64        bs_legacy_mem;    /* legacy mem pio addr */
   u64        bs_base;    /* widget base */
   struct xwidget_info    *bs_xwidget_info;
};
 
struct pci_controller;
/*
 * SN pci bus indirection
 */
 
struct sn_pcibus_provider {
   dma_addr_t    (*dma_map)(struct pci_dev *, unsigned long, size_t, int flags);
   dma_addr_t    (*dma_map_consistent)(struct pci_dev *, unsigned long, size_t, int flags);
   void        (*dma_unmap)(struct pci_dev *, dma_addr_t, int);
   void *        (*bus_fixup)(struct pcibus_bussoft *, struct pci_controller *);
     void        (*force_interrupt)(struct sn_irq_info *);
     void        (*target_interrupt)(struct sn_irq_info *);
};
 
/*
 * Flags used by the map interfaces
 * bits 3:0 specifies format of passed in address
 * bit  4   specifies that address is to be used for MSI
 */
 
#define SN_DMA_ADDRTYPE(x)    ((x) & 0xf)
#define     SN_DMA_ADDR_PHYS    1    /* address is an xio address. */
#define     SN_DMA_ADDR_XIO    2    /* address is phys memory */
#define SN_DMA_MSI        0x10    /* Bus address is to be used for MSI */
 
extern struct sn_pcibus_provider *sn_pci_provider[];
#endif                /* _ASM_IA64_SN_PCI_PCIBUS_PROVIDER_H */