hc
2023-12-11 6778948f9de86c3cfaf36725a7c87dcff9ba247f
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
/* SPDX-License-Identifier: GPL-2.0 */
#ifndef BCM63XX_DEV_ENET_H_
#define BCM63XX_DEV_ENET_H_
 
#include <linux/if_ether.h>
#include <linux/init.h>
 
#include <bcm63xx_regs.h>
 
/*
 * on board ethernet platform data
 */
struct bcm63xx_enet_platform_data {
   char mac_addr[ETH_ALEN];
 
   int has_phy;
 
   /* if has_phy, then set use_internal_phy */
   int use_internal_phy;
 
   /* or fill phy info to use an external one */
   int phy_id;
   int has_phy_interrupt;
   int phy_interrupt;
 
   /* if has_phy, use autonegotiated pause parameters or force
    * them */
   int pause_auto;
   int pause_rx;
   int pause_tx;
 
   /* if !has_phy, set desired forced speed/duplex */
   int force_speed_100;
   int force_duplex_full;
 
   /* if !has_phy, set callback to perform mii device
    * init/remove */
   int (*mii_config)(struct net_device *dev, int probe,
             int (*mii_read)(struct net_device *dev,
                     int phy_id, int reg),
             void (*mii_write)(struct net_device *dev,
                       int phy_id, int reg, int val));
 
   /* DMA channel enable mask */
   u32 dma_chan_en_mask;
 
   /* DMA channel interrupt mask */
   u32 dma_chan_int_mask;
 
   /* DMA engine has internal SRAM */
   bool dma_has_sram;
 
   /* DMA channel register width */
   unsigned int dma_chan_width;
 
   /* DMA descriptor shift */
   unsigned int dma_desc_shift;
 
   /* dma channel ids */
   int rx_chan;
   int tx_chan;
};
 
/*
 * on board ethernet switch platform data
 */
#define ENETSW_MAX_PORT    8
#define ENETSW_PORTS_6328 5 /* 4 FE PHY + 1 RGMII */
#define ENETSW_PORTS_6368 6 /* 4 FE PHY + 2 RGMII */
 
#define ENETSW_RGMII_PORT0    4
 
struct bcm63xx_enetsw_port {
   int        used;
   int        phy_id;
 
   int        bypass_link;
   int        force_speed;
   int        force_duplex_full;
 
   const char    *name;
};
 
struct bcm63xx_enetsw_platform_data {
   char mac_addr[ETH_ALEN];
   int num_ports;
   struct bcm63xx_enetsw_port used_ports[ENETSW_MAX_PORT];
 
   /* DMA channel enable mask */
   u32 dma_chan_en_mask;
 
   /* DMA channel interrupt mask */
   u32 dma_chan_int_mask;
 
   /* DMA channel register width */
   unsigned int dma_chan_width;
 
   /* DMA engine has internal SRAM */
   bool dma_has_sram;
};
 
int __init bcm63xx_enet_register(int unit,
                const struct bcm63xx_enet_platform_data *pd);
 
int bcm63xx_enetsw_register(const struct bcm63xx_enetsw_platform_data *pd);
 
enum bcm63xx_regs_enetdmac {
   ENETDMAC_CHANCFG,
   ENETDMAC_IR,
   ENETDMAC_IRMASK,
   ENETDMAC_MAXBURST,
   ENETDMAC_BUFALLOC,
   ENETDMAC_RSTART,
   ENETDMAC_FC,
   ENETDMAC_LEN,
};
 
static inline unsigned long bcm63xx_enetdmacreg(enum bcm63xx_regs_enetdmac reg)
{
   extern const unsigned long *bcm63xx_regs_enetdmac;
 
   return bcm63xx_regs_enetdmac[reg];
}
 
 
#endif /* ! BCM63XX_DEV_ENET_H_ */