add at24 driver

hc

2023-11-06 15ade055295d13f95d49e3d99b09f3bbfb4a43e7

1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
/*
 *  External Memory Interface
 *
 *  Copyright (C) 2011 Texas Instruments Incorporated
 *  Author: Mark Salter <msalter@redhat.com>
 *
 *  This program is free software; you can redistribute it and/or modify
 *  it under the terms of the GNU General Public License version 2 as
 *  published by the Free Software Foundation.
 */
#include <linux/of.h>
#include <linux/of_address.h>
#include <linux/io.h>
#include <asm/soc.h>
#include <asm/dscr.h>
 
#define NUM_EMIFA_CHIP_ENABLES 4
 
struct emifa_regs {
    u32    midr;
    u32    stat;
    u32    reserved1[6];
    u32    bprio;
    u32    reserved2[23];
    u32    cecfg[NUM_EMIFA_CHIP_ENABLES];
    u32    reserved3[4];
    u32    awcc;
    u32    reserved4[7];
    u32    intraw;
    u32    intmsk;
    u32    intmskset;
    u32    intmskclr;
};
 
static struct of_device_id emifa_match[] __initdata = {
    { .compatible = "ti,c64x+emifa"    },
    {}
};
 
/*
 * Parse device tree for existence of an EMIF (External Memory Interface)
 * and initialize it if found.
 */
static int __init c6x_emifa_init(void)
{
    struct emifa_regs __iomem *regs;
    struct device_node *node;
    const __be32 *p;
    u32 val;
    int i, len, err;
 
    node = of_find_matching_node(NULL, emifa_match);
    if (!node)
        return 0;
 
    regs = of_iomap(node, 0);
    if (!regs)
        return 0;
 
    /* look for a dscr-based enable for emifa pin buffers */
    err = of_property_read_u32_array(node, "ti,dscr-dev-enable", &val, 1);
    if (!err)
        dscr_set_devstate(val, DSCR_DEVSTATE_ENABLED);
 
    /* set up the chip enables */
    p = of_get_property(node, "ti,emifa-ce-config", &len);
    if (p) {
        len /= sizeof(u32);
        if (len > NUM_EMIFA_CHIP_ENABLES)
            len = NUM_EMIFA_CHIP_ENABLES;
        for (i = 0; i <= len; i++)
            soc_writel(be32_to_cpup(&p[i]), &regs->cecfg[i]);
    }
 
    err = of_property_read_u32_array(node, "ti,emifa-burst-priority", &val, 1);
    if (!err)
        soc_writel(val, &regs->bprio);
 
    err = of_property_read_u32_array(node, "ti,emifa-async-wait-control", &val, 1);
    if (!err)
        soc_writel(val, &regs->awcc);
 
    iounmap(regs);
    of_node_put(node);
    return 0;
}
pure_initcall(c6x_emifa_init);