hc
2024-01-05 071106ecf68c401173c58808b1cf5f68cc50d390
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
/*
 * Copyright (c) 2017 Intel Corporation
 *
 * SPDX-License-Identifier:    GPL-2.0+
 */
#include <common.h>
#include <watchdog.h>
#include <asm/scu.h>
 
/* Hardware timeout in seconds */
#define WDT_PRETIMEOUT        15
#define WDT_TIMEOUT_MIN        (1 + WDT_PRETIMEOUT)
#define WDT_TIMEOUT_MAX        170
#define WDT_DEFAULT_TIMEOUT    90
 
#ifndef CONFIG_WATCHDOG_TIMEOUT_MSECS
#define WATCHDOG_HEARTBEAT 60000
#else
#define WATCHDOG_HEARTBEAT CONFIG_WATCHDOG_TIMEOUT_MSECS
#endif
 
enum {
   SCU_WATCHDOG_START            = 0,
   SCU_WATCHDOG_STOP            = 1,
   SCU_WATCHDOG_KEEPALIVE            = 2,
   SCU_WATCHDOG_SET_ACTION_ON_TIMEOUT    = 3,
};
 
void hw_watchdog_reset(void)
{
   static unsigned long last;
   unsigned long now;
 
   if (gd->timer)
       now = timer_get_us();
   else
       now = rdtsc() / 1000;
 
   /* Do not flood SCU */
   if (last > now)
       last = 0;
 
   if (unlikely((now - last) > (WDT_PRETIMEOUT / 2) * 1000000)) {
       last = now;
       scu_ipc_simple_command(IPCMSG_WATCHDOG_TIMER, SCU_WATCHDOG_KEEPALIVE);
   }
}
 
int hw_watchdog_disable(void)
{
   return scu_ipc_simple_command(IPCMSG_WATCHDOG_TIMER, SCU_WATCHDOG_STOP);
}
 
void hw_watchdog_init(void)
{
   u32 timeout = WATCHDOG_HEARTBEAT / 1000;
   int in_size;
   struct ipc_wd_start {
       u32 pretimeout;
       u32 timeout;
   } ipc_wd_start = { timeout - WDT_PRETIMEOUT, timeout };
 
   /*
    * SCU expects the input size for watchdog IPC
    * to be based on 4 bytes
    */
   in_size = DIV_ROUND_UP(sizeof(ipc_wd_start), 4);
 
   scu_ipc_command(IPCMSG_WATCHDOG_TIMER, SCU_WATCHDOG_START,
           (u32 *)&ipc_wd_start, in_size, NULL, 0);
}