hc
2024-01-05 071106ecf68c401173c58808b1cf5f68cc50d390
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
// SPDX-License-Identifier: GPL-2.0
/*
 * Qualcomm A53 PLL driver
 *
 * Copyright (c) 2017, Linaro Limited
 * Author: Georgi Djakov <georgi.djakov@linaro.org>
 */
 
#include <linux/clk-provider.h>
#include <linux/kernel.h>
#include <linux/platform_device.h>
#include <linux/regmap.h>
#include <linux/module.h>
 
#include "clk-pll.h"
#include "clk-regmap.h"
 
static const struct pll_freq_tbl a53pll_freq[] = {
   {  998400000, 52, 0x0, 0x1, 0 },
   { 1094400000, 57, 0x0, 0x1, 0 },
   { 1152000000, 62, 0x0, 0x1, 0 },
   { 1209600000, 63, 0x0, 0x1, 0 },
   { 1248000000, 65, 0x0, 0x1, 0 },
   { 1363200000, 71, 0x0, 0x1, 0 },
   { 1401600000, 73, 0x0, 0x1, 0 },
   { }
};
 
static const struct regmap_config a53pll_regmap_config = {
   .reg_bits        = 32,
   .reg_stride        = 4,
   .val_bits        = 32,
   .max_register        = 0x40,
   .fast_io        = true,
};
 
static int qcom_a53pll_probe(struct platform_device *pdev)
{
   struct device *dev = &pdev->dev;
   struct regmap *regmap;
   struct resource *res;
   struct clk_pll *pll;
   void __iomem *base;
   struct clk_init_data init = { };
   int ret;
 
   pll = devm_kzalloc(dev, sizeof(*pll), GFP_KERNEL);
   if (!pll)
       return -ENOMEM;
 
   res = platform_get_resource(pdev, IORESOURCE_MEM, 0);
   base = devm_ioremap_resource(dev, res);
   if (IS_ERR(base))
       return PTR_ERR(base);
 
   regmap = devm_regmap_init_mmio(dev, base, &a53pll_regmap_config);
   if (IS_ERR(regmap))
       return PTR_ERR(regmap);
 
   pll->l_reg = 0x04;
   pll->m_reg = 0x08;
   pll->n_reg = 0x0c;
   pll->config_reg = 0x14;
   pll->mode_reg = 0x00;
   pll->status_reg = 0x1c;
   pll->status_bit = 16;
   pll->freq_tbl = a53pll_freq;
 
   init.name = "a53pll";
   init.parent_names = (const char *[]){ "xo" };
   init.num_parents = 1;
   init.ops = &clk_pll_sr2_ops;
   init.flags = CLK_IS_CRITICAL;
   pll->clkr.hw.init = &init;
 
   ret = devm_clk_register_regmap(dev, &pll->clkr);
   if (ret) {
       dev_err(dev, "failed to register regmap clock: %d\n", ret);
       return ret;
   }
 
   ret = devm_of_clk_add_hw_provider(dev, of_clk_hw_simple_get,
                     &pll->clkr.hw);
   if (ret) {
       dev_err(dev, "failed to add clock provider: %d\n", ret);
       return ret;
   }
 
   return 0;
}
 
static const struct of_device_id qcom_a53pll_match_table[] = {
   { .compatible = "qcom,msm8916-a53pll" },
   { }
};
MODULE_DEVICE_TABLE(of, qcom_a53pll_match_table);
 
static struct platform_driver qcom_a53pll_driver = {
   .probe = qcom_a53pll_probe,
   .driver = {
       .name = "qcom-a53pll",
       .of_match_table = qcom_a53pll_match_table,
   },
};
module_platform_driver(qcom_a53pll_driver);
 
MODULE_DESCRIPTION("Qualcomm A53 PLL Driver");
MODULE_LICENSE("GPL v2");