hc
2024-01-05 071106ecf68c401173c58808b1cf5f68cc50d390
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
/* SPDX-License-Identifier: GPL-2.0 */
/*
 * Copyright (c) 2018 MediaTek Inc.
 * Author: Owen Chen <owen.chen@mediatek.com>
 */
 
#ifndef __DRV_CLK_MTK_MUX_H
#define __DRV_CLK_MTK_MUX_H
 
#include <linux/clk-provider.h>
 
struct mtk_clk_mux {
   struct clk_hw hw;
   struct regmap *regmap;
   const struct mtk_mux *data;
   spinlock_t *lock;
};
 
struct mtk_mux {
   int id;
   const char *name;
   const char * const *parent_names;
   unsigned int flags;
 
   u32 mux_ofs;
   u32 set_ofs;
   u32 clr_ofs;
   u32 upd_ofs;
 
   u8 mux_shift;
   u8 mux_width;
   u8 gate_shift;
   s8 upd_shift;
 
   const struct clk_ops *ops;
 
   signed char num_parents;
};
 
extern const struct clk_ops mtk_mux_ops;
extern const struct clk_ops mtk_mux_clr_set_upd_ops;
extern const struct clk_ops mtk_mux_gate_ops;
extern const struct clk_ops mtk_mux_gate_clr_set_upd_ops;
 
#define GATE_CLR_SET_UPD_FLAGS(_id, _name, _parents, _mux_ofs,        \
           _mux_set_ofs, _mux_clr_ofs, _shift, _width,    \
           _gate, _upd_ofs, _upd, _flags, _ops) {        \
       .id = _id,                        \
       .name = _name,                        \
       .mux_ofs = _mux_ofs,                    \
       .set_ofs = _mux_set_ofs,                \
       .clr_ofs = _mux_clr_ofs,                \
       .upd_ofs = _upd_ofs,                    \
       .mux_shift = _shift,                    \
       .mux_width = _width,                    \
       .gate_shift = _gate,                    \
       .upd_shift = _upd,                    \
       .parent_names = _parents,                \
       .num_parents = ARRAY_SIZE(_parents),            \
       .flags = _flags,                    \
       .ops = &_ops,                        \
   }
 
#define MUX_GATE_CLR_SET_UPD_FLAGS(_id, _name, _parents, _mux_ofs,    \
           _mux_set_ofs, _mux_clr_ofs, _shift, _width,    \
           _gate, _upd_ofs, _upd, _flags)            \
       GATE_CLR_SET_UPD_FLAGS(_id, _name, _parents, _mux_ofs,    \
           _mux_set_ofs, _mux_clr_ofs, _shift, _width,    \
           _gate, _upd_ofs, _upd, _flags,            \
           mtk_mux_gate_clr_set_upd_ops)
 
#define MUX_GATE_CLR_SET_UPD(_id, _name, _parents, _mux_ofs,        \
           _mux_set_ofs, _mux_clr_ofs, _shift, _width,    \
           _gate, _upd_ofs, _upd)                \
       MUX_GATE_CLR_SET_UPD_FLAGS(_id, _name, _parents,    \
           _mux_ofs, _mux_set_ofs, _mux_clr_ofs, _shift,    \
           _width, _gate, _upd_ofs, _upd,            \
           CLK_SET_RATE_PARENT)
 
struct clk *mtk_clk_register_mux(const struct mtk_mux *mux,
                struct regmap *regmap,
                spinlock_t *lock);
 
int mtk_clk_register_muxes(const struct mtk_mux *muxes,
              int num, struct device_node *node,
              spinlock_t *lock,
              struct clk_onecell_data *clk_data);
 
#endif /* __DRV_CLK_MTK_MUX_H */